# 유럽, "DARE"로 슈퍼컴퓨팅을 위해 다시 한번 RISC-V에 베팅

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- Author: [neo](https://news.hada.io/@neo)
- Published: 2025-03-11T13:06:25+09:00
- Updated: 2025-03-11T13:06:25+09:00
- Original source: [theregister.com](https://www.theregister.com/2025/03/07/dare_europe_risc_v_project/)
- Points: 3
- Comments: 1

## Topic Body

- 유럽의 기술 기업 38곳이 참여한 **Digital Autonomy with RISC-V in Europe(DARE)** 프로젝트가 출범  
  - 목표: 유럽의 **슈퍼컴퓨터** 및 고성능 머신에 사용할 **프로세서 유닛 개발**  
- 유럽은 이미 수년간 RISC-V 기반 슈퍼컴퓨팅에 관심을 가져왔으나 첫 엑사스케일 시스템은 Arm 아키텍처를 사용함  
- 미국과의 기술 독립성 확보를 위한 시도  
  
### DARE 프로젝트 주요 내용  
- **EuroHPC Joint Undertaking** 지원, **Barcelona Supercomputing Center(BSC-CNS)**에서 주도  
- 3개의 칩렛(chiplet) 개발 목표 설정:  
  - **벡터 수학 가속기**: HPC 작업용, 바르셀로나의 **Openchip**에서 주도  
  - **차세대 추론 칩렛**: 네덜란드의 **Axelera AI**에서 주도  
  - **범용 프로세서**: 독일의 **Codasip**에서 주도  
- 프로젝트 리더인 **Osman Unsal**: "**유럽의 디지털 주권을 위한 복잡한 기술 개발 도전**"이라고 언급  
  
### 프로젝트 일정 및 자금 지원  
- 첫 단계는 **6년 기한**, 3개 RISC-V 칩렛을 **3년 내** 개발 목표  
- 총 **2억 4천만 유로**(약 3,600억 원) 규모의 자금 지원  
- Axelera AI는 EuroHPC로부터 **6,160만 유로**(약 920억 원) 확보  
  
### Axelera AI의 역할 및 성과  
- Axelera AI의 현재 칩은 주로 네트워크 엣지에서 AI 모델 구동  
- 차세대 **Titania** 칩렛은 서버급 작업에 최적화 예정  
- 주요 특징:  
  - 4개의 가속 코어 포함  
  - 각 코어는 행렬 곱셈 누산(MAC) 유닛 포함  
  - 프로그래머블한 RISC-V 제어 코어 포함  
  - 뉴럴 네트워크 활성화 함수 처리용 DSP 포함  
  - 내장 SRAM으로 메모리 내 처리(in-memory processing) 지원  
- **200 INT8 TOPS** 성능 달성 가능 (소비 전력은 **15~20W**)  
- Titania는 프로세서 코어와 멀티다이 시스템을 통해 확장 계획  
  
### Codasip의 역할 및 목표  
- 현재 32비트 임베디드 및 64비트 애플리케이션급 RISC-V 코어 보유  
- DARE 프로젝트를 통해 고성능 RISC-V 프로세서 포트폴리오 확장 목표  
  - AI, 빅데이터 처리, 슈퍼컴퓨팅 작업 포함  
  
* Openchip의 벡터 가속기에 대한 구체적인 세부 사항은 공개되지 않음  
  
### 글로벌 RISC-V 동향  
- 유럽 외에도 다른 국가에서 RISC-V 채택 확산 중  
  - **인도**: 자국 기술 독립을 위한 RISC-V 채택  
  - **중국**: Alibaba의 **XuanTie C930** 발표 → PC부터 자동차까지 적용 가능  
- 미국에서는 중국의 RISC-V 기술 접근을 제한하려는 움직임 존재

## Comments



### Comment 35716

- Author: neo
- Created: 2025-03-11T13:06:26+09:00
- Points: 1

###### [Hacker News 의견](https://news.ycombinator.com/item?id=43311091) 
* 중국이 최근 RISC-V 칩 사용을 전국적으로 확대하는 정책을 발표할 예정임. EU와 중국 간의 협력이 기대됨
* RISC-V의 발전을 위해서는 Raspberry Pi와 유사한 프로젝트에 자금을 지원하여 열성적인 사용자들에게 유용한 기기를 제공해야 함
  - 소프트웨어 포팅을 위한 저렴한 컴퓨터가 필요함
  - 준비된 소프트웨어가 없다면 하드웨어는 무의미함
* 일반 컴퓨팅에도 적용되어야 하며, 정부 사무실 컴퓨터부터 시작해야 함
  - x86에 Windows 11을 설치한 것보다 느릴 수는 없음
* hpcasia25의 관련 슬라이드와 FPGA 에뮬레이션 플랫폼 보고서가 있음
  - Semidynamics의 Atrevido 코어와 Vitruvius VPU를 사용한 벡터 프로세서 개발 중임
  - 최근 보고서에 따르면 16,384 비트의 벡터 길이와 16개의 레인을 가짐
  - 32개의 코어, 공유 L3 캐시, HBM 접근을 목표로 함
* 수출 규제에 의해 통제되지 않는 OS와 프로그래밍 언어에 의존해야 함
* 유럽이 슈퍼컴퓨팅 주권을 위해 노력하는 것에 대해 회의적임
  - 유럽은 자체 칩을 만들 가능성을 포기했으며, 중국의 공급에 의존할 수밖에 없음
* ARM이 100% 영국 유럽 기업이라는 아이러니가 있음
* Axelera의 칩은 Google의 텐서 프로세싱 유닛과 유사한 공식을 따름
  - 현재 아키텍처에 집중되어 있으며, 행렬 곱셈의 근본적 한계를 벗어날 수 있는 새로운 것이 필요함
* 유럽의 투자 규모가 너무 작음
  - 6년 동안 2억 4천만 유로의 자금 지원은 부족함
  - 미국의 기업들은 수십억 달러를 투자하고 있음
  - 38개의 파트너에게 자금을 분산하는 대신 집중된 투자 필요함
  - EU는 기술에 대해 진지하지 않음
  - 미국과의 신뢰가 떨어지고 있는 상황에서 더 큰 투자가 필요함
* RISC-V를 슈퍼컴퓨팅 주권을 위해 선택한 사람들은 결국 중국 제품을 구매할 가능성이 높음